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[공학] System On Chip 설계 및 응용 - 시계 + 스탑워치 + 시간설정 + 알람설정 구현

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작성일 19-05-31 14:55

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최종 프로젝트
Digital Clock 설계
`목 차`
1. 시계 블록도(1page)

2. VHDL 소스 설명(說明)(2~42page)
① easy_clock.vhd
② clock.vhd
③ stopwatch.vhd
④ setclock.vhd
⑤ setalarm.vhd
⑥ alarm_dot.vhd
⑥ seven_seg.vhd

3. 동작방법(43page)

4. 동작결과

5. 고 찰

시계 + 스탑워치 + 시간설정 + 알람설정 구현!!
1. 시계 블록도

Clock

Stopwatch

Seven_SEG

SetClock

SetAlarm

CLK_IN

RESET

SWITCH

put

Alarm_DOT

DOT
matrix

bintoseg

LED

7 Segment
index

2. VHDL 소스 설명(說明)
① easy_c...

최종 프로젝트
Digital Clock 설계
`목 차`
1. 시계 블록도(1page)

2. VHDL 소스 설명(說明)(2~42page)
① easy_clock.vhd
② clock.vhd
③ stopwatch.vhd
④ setclock.vhd
⑤ setalarm.vhd
⑥ alarm_dot.vhd
⑥ seven_seg.vhd

3. 동작방법(43page)

4. 동작결과

5. 고 찰

시계 + 스탑워치 + 시간설정 + 알람설정 구현!!
1. 시계 블록도

Clock

Stopwatch

Seven_SEG

SetClock

SetAlarm

CLK_IN

RESET

SWITCH

put

Alarm_DOT

DOT
matrix

bintoseg

LED

7 Segment
index

2. VHDL 소스 설명(說明)
① easy_clock.vhd

library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_arith.all;
use ieee.std_logic_unsigned.all;

entity easy_clock is
port (
clk_in : in std_logic;
resetn : in std_logic;
switch : in std_logic_vector(8 downto 0); //숫자switch 입력 벡터로 선언(1~9)
led_out : out std_logic_vector(7 downto 0);
dot_col_reg : out std_logic_vector(9 downto 0); //dot matrix 의 열 벡터로 선언(세로10개)
dot_raw_reg : out std_logic_vector(13 downto 0); //dot matri…(drop)

[공학] System On Chip 설계 및 응용 - 시계 + 스탑워치 + 시간설정 + 알람설정 구현
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[공학] System On Chip 설계 및 응용 - 시계 + 스탑워치 + 시간설정 + 알람설정 구현
순서
레포트/공학기술

설명

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번호	제목
23827	맘에드는 납연기 사람들이 왜이렇게 찾는지 알거같네요
23826	선물하고픈 베나엔단계압박슬리브 이네요.
23825	선물같은 절삭기 요즘 이거 없이는 못살겠어요 ㅎㅎ
23824	너무 좋습니다 보성탄력허리보호대 BEST 믿고쓰는
23823	정직한 , . 아.시.겠.어.요? 소음방지귀덮개
23822	알토란같은 1톤물탱크 알아보자 빨리
23821	이런건 금방 동날수도 있대요 진또배기 라기올와인오프너 선택 입니다. 추천합니다!
23820	요즘 이거 없이는 못살겠어요 ㅎㅎ 다이아몬드줄 BEST 품질보증
23819	SNS에서도 난리났대요 신뢰가는 클릭비콘서트cd
23818	역대최강 , 너무 좋네요 화이트보드소형
23817	만족스럽네요 ㅎㅎ 테이프디스펜서
23816	요즘대세 어깨회전근개파열보조기 개봉! 친구들도 인정하네요
23815	구성이 참 좋아요 칼라마스크 BEST 정직한
23814	신뢰가는 벨버드젖병 후회 안할겁니다 ㅎㅎ
23813	맘에드는 문호스트레이독스6권 이네용 이건 사야합니다

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